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你有沒有遇到這種情況：主控芯片標稱待機電流100μA，軟件也進了深度睡眠，可整機實測靜態電流卻高出十幾倍？別急著懷疑固件或換芯片——問題很可能出在PCB實現上。

這不只是控制邏輯的問題，更是PCB層面的設計考量：使能信號是否穩定？MOS管開關路徑是否足夠短？斷電后回路會不會通過其他路徑“偷電”？比如某個傳感器的地雖然電源斷了，但信號線還連著主控，形成漏電通路——這種細節，仿真不一定能抓到，只有實測才會暴露。

再比如電源域隔離。很多工程師會在原理圖上畫出獨立供電，但在PCB布局時為了布線方便，把多個域的地混在一起鋪銅，結果域間干擾嚴重，不僅功耗上不去，還影響喚醒穩定性。

還有DC-DC與LDO的搭配使用。我們見過不少設計，在主電源用高效DC-DC，卻在后級為圖省事全用LDO穩壓，忽略了壓差大時的熱損耗。正確的做法是在關鍵節點評估效率與噪聲的平衡，必要時加入功率MOS做硬開關，真正實現“斷得干凈”。

這些都不是理論難題，而是工程落地的經驗判斷。芯片廠給的是理想條件下的數據，而我們要面對的是寄生參數、布局限制、成本約束。真正的低功耗，是系統思維+工藝實現的結合。

我不是要挑戰誰的專業，而是想說：軟件決定功能上限，硬件決定性能底線，而PCB，是讓一切設計真正落地的物理基礎。